X-DSP ALU与移位部件的设计与实现 被引量：1

1

作者 彭元喜 邹佳骏 《计算机应用》 CSCD 北大核心 2010年第7期1978-1982,共5页

针对DSP CPU的算术运算逻辑单元(ALU)与移位部件在性能、功耗与面积上面临的挑战,研究了X型DSP的CPU体系结构,在对X型DSP ALU部件和移位器部件相关指令进行归类分析的基础上,设计实现了ALU部件和移位器部件。采用Design Compiler综合工... 针对DSP CPU的算术运算逻辑单元(ALU)与移位部件在性能、功耗与面积上面临的挑战,研究了X型DSP的CPU体系结构,在对X型DSP ALU部件和移位器部件相关指令进行归类分析的基础上,设计实现了ALU部件和移位器部件。采用Design Compiler综合工具,基于SMIC公司0.13μm CMOS工艺库对ALU移位部件进行了逻辑综合,电路功耗共为4.2821 mW,电路面积为71042.9804μm2,工作频率达到250 MHz。 展开更多

关键词 数字信号处理器 算术运算逻辑单元 桶形移位器 核心加法器 验证

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基于规则的寄存器传输级ALU工艺映射算法的研究

2

作者 周海峰 林争辉 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2002年第4期289-291,305,共4页

提出寄存器传输级工艺映射 (RTLM)算法 ,该算法支持使用高层次综合和设计再利用的现代VLSI设计方法学 ,允许复杂的RT级组件 ,尤其是算术逻辑单元 (ALU)在设计中重用 .该映射算法使用目标ALU组件来实现源ALU组件 ,映射规则通过表格的方... 提出寄存器传输级工艺映射 (RTLM)算法 ,该算法支持使用高层次综合和设计再利用的现代VLSI设计方法学 ,允许复杂的RT级组件 ,尤其是算术逻辑单元 (ALU)在设计中重用 .该映射算法使用目标ALU组件来实现源ALU组件 ,映射规则通过表格的方式给出 .此算法对于规则结构的数据通路特别有效 .应用k阶贪婪算法的实验结果表明 ,RTLM在高层次综合中对数据通路组件再利用是一种有效的方法 . 展开更多

关键词 高层次综合 寄存器传输级 算术逻辑单元 贪婪算法 工艺映射算法 超大规模集成电路

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基于OpenMP与VALU硬件加速的表面积分方程矩量法混合并行求解技术 被引量：2

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作者 刘金波 何芒 《北京理工大学学报》 EI CAS CSCD 北大核心 2014年第1期50-55,共6页

研究在共享内存式计算机架构下,基于OpenMP及矢量算术逻辑单元(VALU)硬件加速的表面积分方程矩量法的混合并行求解技术.讨论了矩量法并行程序设计中的关键问题,并分析了影响并行计算的主要因素.针对一些典型散射目标,给出了由混合并行... 研究在共享内存式计算机架构下,基于OpenMP及矢量算术逻辑单元(VALU)硬件加速的表面积分方程矩量法的混合并行求解技术.讨论了矩量法并行程序设计中的关键问题,并分析了影响并行计算的主要因素.针对一些典型散射目标,给出了由混合并行程序得到的雷达散射截面数值结果.通过对计算数据的对比分析,指出负载平衡及内存读取连续性是影响混合并行效率的关键问题所在. 展开更多

关键词 OPENMP 矢量算术逻辑单元(Valu) 表面积分方程 矩量法 内存延迟

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逻辑平衡与高速数字电路 被引量：1

4

作者 周昔平 高德远 樊晓桠 《计算机工程与应用》 CSCD 北大核心 2002年第21期25-28,共4页

在设计者进行系统和电路级设计时,时常会将要实现的逻辑功能或操作较为平均地分配到时序中的各个阶段,称之为逻辑平衡设计。该论文引用了逻辑平衡的方法,将其运用在高速数字部件设计中,以常用运算单元如计数器,有限状态机和乘法器的高... 在设计者进行系统和电路级设计时,时常会将要实现的逻辑功能或操作较为平均地分配到时序中的各个阶段,称之为逻辑平衡设计。该论文引用了逻辑平衡的方法,将其运用在高速数字部件设计中,以常用运算单元如计数器,有限状态机和乘法器的高性能设计方案为例,分析了逻辑平衡在高速集成电路设计中的应用;并分析了逻辑平衡的方法在减小电路面积,提高电路的性价比和降低电路功耗中的作用。 展开更多

关键词 逻辑平衡 高速数字电路 运算单元 设计

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4个加数的并行加法器及扩展接口的研究 被引量：2

5

作者 刘杰 易茂祥 《合肥工业大学学报（自然科学版）》 CAS CSCD 北大核心 2009年第11期1683-1686,共4页

算术逻辑运算单元(ALU)决定着中央处理器(CPU)的性能,而加法器又决定着ALU的性能。为了提高CPU的性能,文章提出了一种4个加数的并行加法器及其接口扩展的研究方案,论述了所提新型加法器的工作原理和过程,同时描述了接口扩充思想;最后,采... 算术逻辑运算单元(ALU)决定着中央处理器(CPU)的性能,而加法器又决定着ALU的性能。为了提高CPU的性能,文章提出了一种4个加数的并行加法器及其接口扩展的研究方案,论述了所提新型加法器的工作原理和过程,同时描述了接口扩充思想;最后,采用MAX+PLUSⅡ对设计电路进行了模拟验证,实验结果说明了所提加法器的设计合理性。 展开更多

关键词 算术逻辑运算单元 加法器 超前进位加法器

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基于现场可编程门阵列的RISC处理器设计 被引量：1

6

作者 东野长磊 《计算机工程》 CAS CSCD 北大核心 2011年第11期242-244,共3页

基于现场可编程门阵列(FPGA)平台,设计嵌入式精简指令集计算机(RISC)中央处理器(CPU)。参考无内部互锁流水级微处理器(MIPS)指令集制定原则设计CPU指令集,通过分析指令处理过程构建嵌入式CPU的5级流水线,结合数据前推技术和软件编译方... 基于现场可编程门阵列(FPGA)平台,设计嵌入式精简指令集计算机(RISC)中央处理器(CPU)。参考无内部互锁流水级微处理器(MIPS)指令集制定原则设计CPU指令集,通过分析指令处理过程构建嵌入式CPU的5级流水线,结合数据前推技术和软件编译方法解决流水线相关性问题,并实现CPU的算术逻辑单元、控制单元、指令cache等关键模块设计。验证结果表明,该嵌入式RISC CPU的速度和稳定性均达到设计要求。 展开更多

关键词 现场可编程门阵列 精简指令集计算机处理器 流水线相关性 算术逻辑单元

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一种具有逻辑仿真功能的MCAI软件设计与实现

7

作者 王化兰 《计算机工程与应用》 CSCD 北大核心 2001年第18期148-149,161,共3页

文章主要介绍了自行研制的具有逻辑仿真功能的计算机组成原理实验多媒体CAI软件的设计思想，并从软件的总体设计、性能特点和设计技巧三个方面进行了阐述。

关键词 计算机组成原理 逻辑仿真 MCAI 教学软件

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扩展型资源共享方案在RTL综合中的实现

8

作者 刘贵宅 于芳 +2 位作者 刘忠立 刁岚松 吴洋 《深圳大学学报（理工版）》 EI CAS 北大核心 2013年第5期456-461,共6页

针对现有寄存器传输级(register transfer level,RTL)综合中资源共享仅针对算术逻辑单元(arithmetic logic unit,ALU)的问题,提出扩展型资源共享的方法.该方法对所有逻辑门进行共享,既可优化ALU,又可优化普通逻辑单元,突破了资源共享基... 针对现有寄存器传输级(register transfer level,RTL)综合中资源共享仅针对算术逻辑单元(arithmetic logic unit,ALU)的问题,提出扩展型资源共享的方法.该方法对所有逻辑门进行共享,既可优化ALU,又可优化普通逻辑单元,突破了资源共享基于多路选择器(multiplexer,MUX)的限制,实现算术优化及逻辑优化.实验结果与开源工具ABC比较,LUT数减少了19.2%,表明该方法不仅可减少算术逻辑单元的数目,也可有效减少普通逻辑资源的数目,最终实现面积优化. 展开更多

关键词 微电子学 现场可编程门阵列 资源共享 寄存器传输级 寄存器传输级综合 算术逻辑单元 面积优化 逻辑优化

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优先级资源共享在RTL综合中的实现

9

作者 刘贵宅 于芳 +1 位作者 刘忠立 刁岚松 《华南理工大学学报（自然科学版）》 EI CAS CSCD 北大核心 2013年第6期23-27,共5页

针对现场可编程门阵列内部复杂算术操作资源有限、资源占用面积较大以及RTL级(寄存器传输级)综合中面积优化大多仅针对一般逻辑操作的问题,提出了一种优先级资源共享方法.该方法通过改进普通的资源共享方法,使不同时刻进行的算术逻辑单... 针对现场可编程门阵列内部复杂算术操作资源有限、资源占用面积较大以及RTL级(寄存器传输级)综合中面积优化大多仅针对一般逻辑操作的问题,提出了一种优先级资源共享方法.该方法通过改进普通的资源共享方法,使不同时刻进行的算术逻辑单元(ALU)按照相同输出、相同输入、无共同端口的优先级顺序依次进行共享.实验结果表明:该方法不仅可以减小ALU的个数,达到面积优化的效果,而且和普通的资源共享方法相比,其所需多路选择器更少,时序结果更好,还能避免数据流冲突. 展开更多

关键词 资源共享 现场可编程门阵列 寄存器传输级 综合 算术逻辑单元 面积优化

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TDS系列计算机组成原理教学实验系统的改进

10

作者 朱光前 任志考 《实验室研究与探索》 CAS 2001年第1期59-60,共2页

指出了“TDS系列计算机组成原理教学实验系统”数据通路易发生数据冲突的问题 。

关键词 教学实验系统 运算器单元电路 三态门 数据冲突 数据总线

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基于FPGA的简易计算机设计

11

作者 王承伟 王明顺 《黄金学报》 2001年第4期301-305,共5页

讨论了基于EDA技术的FPGA设计方法,分析了用FPGA实现简易计算机的设计思路,提出了一种设计方法,并用VHDL语言进行了描述,通过仿真运行结果分析,证明了设计的正确性.本设计具有良好可扩充性。

关键词 电子设计自动化 现场可编程门阵列 VHDL 算数逻辑单元 计算机 设计

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基于连续逻辑的十值十进制算术运算电路的设计

12

作者 顾秋心 《电子学报》 EI CAS CSCD 北大核心 1994年第8期99-101,共3页

本文提出了用ＤＹＬ系列器件构成的直接用十进制进行运算的十值电路；ＤＹＬ器件是一种线性元件，它可以工作于０～３Ｖ范围内的任意信号电压，对信号的分辨率极高，为实现高信息密度的十值电路提供了方便条件。本文提出的电路其工作原... 本文提出了用ＤＹＬ系列器件构成的直接用十进制进行运算的十值电路；ＤＹＬ器件是一种线性元件，它可以工作于０～３Ｖ范围内的任意信号电压，对信号的分辨率极高，为实现高信息密度的十值电路提供了方便条件。本文提出的电路其工作原理是基于一种我们称之为＂赋值－选通＂的方法。将可能的输出值全部赋予电路，根据输入信息，通过选通电路直接将计算结果输出。这种赋值－选通法对多值电路的设计有普遍意义。 展开更多

关键词 连续逻辑 算术运算器 运算电路

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