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多段LC VCO的自适应频段选择技术 被引量:2
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作者 齐贺飞 陈陵都 +2 位作者 赵瑞华 李晋 陈君涛 《半导体技术》 CAS CSCD 北大核心 2013年第11期812-816,共5页
摘要:研究了一款单片CMOSLc压控振荡器(VCO)。除可变电容和开关电容阵列外,设计中还应用了二叉树的原理。多频段VCO自适应选择最优工作频段,将压控电压置于预先设定的范围内,谐振频率放在该频段的中心附近,提高了VCO的工作稳定... 摘要:研究了一款单片CMOSLc压控振荡器(VCO)。除可变电容和开关电容阵列外,设计中还应用了二叉树的原理。多频段VCO自适应选择最优工作频段,将压控电压置于预先设定的范围内,谐振频率放在该频段的中心附近,提高了VCO的工作稳定性。设计难点在于如何控制压控电压位于合适的范围。将该VCO应用在锁相环(PLL)中,对锁相环芯片测试的结果表明,当压控电压为1~2V时,锁相环能够快速锁定,频率输出范围为600~1300MHz。电荷泵的NMOS和PMOS匹配最佳,相位噪声最好。自适应频段选择技术还提高了锁相环的工作可靠性,强制控制电压进入设定区间,保证了锁相环可靠入锁,在高、低温下也不会发生失锁。 展开更多
关键词 压控振荡器(VCO) 二叉树 锁相环(PLL) 稳定性 多频段
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一种抗单粒子效应的加固技术研究 被引量:3
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作者 齐贺飞 王磊 +2 位作者 王鑫 王绍权 张梦月 《现代信息科技》 2022年第6期41-45,共5页
针对数字波控电路在星载控制电路应用中存在的单粒子翻转效应问题,提出了一种基于DICE单元的双稳态D触发器设计改进,设计了一种能够抵御众多类型单粒子翻转效应的D触发器,并基于该D触发器,结合电路级单粒子加固技术设计了一款串并转换... 针对数字波控电路在星载控制电路应用中存在的单粒子翻转效应问题,提出了一种基于DICE单元的双稳态D触发器设计改进,设计了一种能够抵御众多类型单粒子翻转效应的D触发器,并基于该D触发器,结合电路级单粒子加固技术设计了一款串并转换芯片。测试表明,采用改进D触发器结构的波控芯片能够抵御至少80 MeV的单粒子效应事件。芯片峰值功耗不大于10 mA,写入速率不低于10 MHz,功耗为1 mW/MHz。 展开更多
关键词 单粒子效应 抗辐照 三模冗余
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一种基于CMOS工艺的低相噪压控振荡器的设计 被引量:3
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作者 齐贺飞 王磊 +2 位作者 王鑫 王绍权 张梦月 《现代信息科技》 2022年第12期52-55,共4页
基于标准CMOS工艺,设计了一款适用于无线通信的基于标准CMOS工艺的频带压控振荡器,该芯片的中心频率2.8 GHz,芯片面积0.5×0.5 mm^(2),典型功耗为11 mA@3.3 V。测试结果表明,在0.8 V~2.5 V的电压调节范围内,压控振荡器输出频率范围... 基于标准CMOS工艺,设计了一款适用于无线通信的基于标准CMOS工艺的频带压控振荡器,该芯片的中心频率2.8 GHz,芯片面积0.5×0.5 mm^(2),典型功耗为11 mA@3.3 V。测试结果表明,在0.8 V~2.5 V的电压调节范围内,压控振荡器输出频率范围为2.3 GHz~3.3 GHz,通过电容阵列实现了1 GHz的调谐带宽,在2.8 GHz频率时的典型相位噪声为-81 dBc/Hz@10 kHz,压控振荡器的典型增益为40 MHz/V。 展开更多
关键词 压控振荡器 可变电容 相位噪声
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一种用于图像加速的DMA2D控制器 被引量:4
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作者 王磊 王鑫 +2 位作者 王绍权 闫维高 齐贺飞 《半导体技术》 CAS 北大核心 2022年第7期564-569,共6页
随着片上系统(SoC)规模的不断增大,直接内存存取(DMA)控制器的功能也越来越完善,但目前对DMA控制器用于图像处理方面的理论研究和实现方法却鲜有报道。为了提高液晶屏(LCD)图像的刷新速度并降低内核的资源占用,提出了一种用于图像数据... 随着片上系统(SoC)规模的不断增大,直接内存存取(DMA)控制器的功能也越来越完善,但目前对DMA控制器用于图像处理方面的理论研究和实现方法却鲜有报道。为了提高液晶屏(LCD)图像的刷新速度并降低内核的资源占用,提出了一种用于图像数据处理的二维DMA(DMA2D)控制器。该控制器基于先进高性能总线(AHB)完成数据传输,支持多种RGB图像输入输出格式并且能够进行两层图像的混合处理运算。对DMA2D的技术和工作原理进行分析,提出了较为完善的DMA2D控制器的设计方案。后端设计基于28 nm工艺库,测试结果表明,DMA2D控制器的工作频率可达到180 MHz,面积仅为400μm×500μm,相比于通用DMA控制器,其面积减小约69%,功耗仅为2.97 mW。DMA2D控制器加速启用后,速度提升约60%,数据传输速度可达330 MiB/s,显著提高了液晶屏的图像刷新速度。 展开更多
关键词 直接内存存取(DMA) 先进高性能总线(AHB)协议 物理设计 片上系统(SoC) 图像加速
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18GHz整数频率合成芯片
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作者 李晋 齐贺飞 +2 位作者 王硕 蒋永红 赵瑞华 《半导体技术》 CAS CSCD 北大核心 2016年第7期488-492,498,共6页
设计了一款工作频率可达18 GHz的低噪声整数频率合成芯片。该芯片内部集成参考分频器、频率鉴相电路、电荷泵电路、射频分频器等。对影响锁相环带内相位噪声的两个关键电路(鉴频鉴相器和电荷泵电路)进行了详细分析。对射频分频器电路... 设计了一款工作频率可达18 GHz的低噪声整数频率合成芯片。该芯片内部集成参考分频器、频率鉴相电路、电荷泵电路、射频分频器等。对影响锁相环带内相位噪声的两个关键电路(鉴频鉴相器和电荷泵电路)进行了详细分析。对射频分频器电路也进行了详细的讨论。用Si Ge Bi CMOS工艺进行了流片,芯片面积为2 100μm×1 900μm。测试结果表明,芯片在(3.3±0.3)V,温度为-55~85℃环境下,可以稳定工作,典型电流为76 m A,实现射频分频器工作频率为4~18 GHz,参考分频器工作频率为1~160 MHz,鉴相器工作频率为1~105 MHz,典型归一化本底噪声为-228 d Bc/Hz。该芯片在超宽带低噪声频率合成的微波组件中有很好的应用前景。 展开更多
关键词 锁相环(PLL) 超宽带 电荷泵 分频器 相位噪声
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