高性能LS-DSP的逻辑设计与低功耗设计 被引量：2

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作者 车德亮 周国昌 +2 位作者 李伟 赵宁 沈绪榜 《微电子学与计算机》 CSCD 北大核心 2006年第1期15-20,24,共7页

LS-DSP是面向数据密集型和控制密集型处理应用的需要,而开发的高性能数字信号处理器。本文主要介绍LS-DSP内有特点的逻辑设计技和低功耗设计技术。LS-DSP采用0.18ΜMCMOS工艺制造,集成度为1000万器件,芯片面积5×5MM2,主频为120MHZ... LS-DSP是面向数据密集型和控制密集型处理应用的需要,而开发的高性能数字信号处理器。本文主要介绍LS-DSP内有特点的逻辑设计技和低功耗设计技术。LS-DSP采用0.18ΜMCMOS工艺制造,集成度为1000万器件,芯片面积5×5MM2,主频为120MHZ,典型应用的平均动态功耗为325.084MW。 展开更多

关键词 数据路径 ALU 乘法器 地址产生器 总线低功耗 海明距离

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LS-DSP数字信号处理器总线的低功耗设计 被引量：3

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作者 车德亮 李剑川 沈绪榜 《国防科技大学学报》 EI CAS CSCD 北大核心 2005年第2期80-86,共7页

随着数字信号处理器制造工艺的进步,总线的功耗已经成为数字信号处理器功耗的主要组成部分。研究了LS DSP数字信号处理器地址总线、数据总线、内部数据总线三类总线的低功耗设计技术,主要采用了总线编码的方法实现总线的低功耗。实验结... 随着数字信号处理器制造工艺的进步,总线的功耗已经成为数字信号处理器功耗的主要组成部分。研究了LS DSP数字信号处理器地址总线、数据总线、内部数据总线三类总线的低功耗设计技术,主要采用了总线编码的方法实现总线的低功耗。实验结果表明,LS DSP采用总线低功耗技术后,有效地降低了总线的功耗。 展开更多

关键词 总线编码 海明距离 串扰 数字信号处理器

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DSP芯片中浮点加法器LOD电路的设计

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作者 车德亮 黄士坦 +2 位作者 刘军华 唐威 段来仓 《微电子学与计算机》 CSCD 北大核心 2003年第4期60-62,65,共4页

DSP芯片中浮点加法器的速度制约着整个芯片的工作速度,浮点加法器中LOD电路的速度又是浮点加法器工作速度的瓶颈。因此,我们可以通过对LOD电路的改进,来提高整个DSP芯片的工作性能。我们从LOD的组成结构和逻辑两个方面进行设计,实现了... DSP芯片中浮点加法器的速度制约着整个芯片的工作速度,浮点加法器中LOD电路的速度又是浮点加法器工作速度的瓶颈。因此,我们可以通过对LOD电路的改进,来提高整个DSP芯片的工作性能。我们从LOD的组成结构和逻辑两个方面进行设计,实现了一种快速、高效的LOD电路。它针对处理的数据格式为TMS320C3X扩展精度浮点数据格式。 展开更多

关键词 浮点加法器 LOD电路 设计 DSP芯片 数字信号处理器 运算速度

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SMDSP浮点数字信号处理器CPU内功能单元的设计

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作者 车德亮 刘文平 《微电子学与计算机》 CSCD 北大核心 2005年第2期183-187,共5页

SMDSP是针对专门应用开发的高性能32位浮点数字信号处理器,其CPU内有独立的ALU、乘法器、数据地址产生器和六条局部数据总线,实现了乘加运算并行,算术运算与地址运算并行,加快了数据处理速度。数据地址产生器支持顺序、倒位序、循环三... SMDSP是针对专门应用开发的高性能32位浮点数字信号处理器,其CPU内有独立的ALU、乘法器、数据地址产生器和六条局部数据总线,实现了乘加运算并行,算术运算与地址运算并行,加快了数据处理速度。数据地址产生器支持顺序、倒位序、循环三类数据地址的计算,使得SMDSP能方便高效地应用于数字信号处理系统。 展开更多

关键词 浮点数字信号处理器 CPU 加法器 乘法器 数据地址生成器

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一种用于优化嵌入式FIR滤波器总线功耗的系数重排算法

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作者 车德亮 沈绪榜 《微电子学与计算机》 CSCD 北大核心 2005年第12期1-3,7,共4页

嵌入式系统对低功耗的要求,使得低功耗设计成为VLSI的主要挑战之一。在嵌入式数字信号处理系统中,可通过降低系统总线的变化率来减少系统功耗。文章研究了一种滤波系数重排算法,用于降低嵌入式FIR滤波器的总线功耗。试验结果表明,该滤... 嵌入式系统对低功耗的要求,使得低功耗设计成为VLSI的主要挑战之一。在嵌入式数字信号处理系统中,可通过降低系统总线的变化率来减少系统功耗。文章研究了一种滤波系数重排算法,用于降低嵌入式FIR滤波器的总线功耗。试验结果表明,该滤波系数重排算法可有效降低54%至69%的嵌入式FIR滤波器总线功耗。 展开更多

关键词 总线低功耗 翻转率 海明距离 FIR

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DSP芯片外部存储器接口设计一例 被引量：5

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作者 刘军华 刘文平 +2 位作者 唐威 车德亮 段来仓 《微电子学与计算机》 CSCD 北大核心 2003年第3期17-20,共4页

文章介绍了一个32位通用DSP芯片中外部存储器接口的设计方案。该方案的突出特点是:接口位宽可根据片外存储器的位宽灵活地调整为8/16/32位,并可同时适应内部数据类型8/16/32位的变换。

关键词 DSP芯片 外部存储器 接口 设计 数字信号处理器

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DSP处理器循环寻址和位翻转寻址的设计 被引量：3

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作者 段来仓 黄士坦 +2 位作者 刘军华 唐威 车德亮 《微电子学与计算机》 CSCD 北大核心 2003年第1期11-13,16,共4页

文章介绍了DSP(digitalsignalprocessing)处理器中面向滤波、FFT、卷积、相关等算法的循环寻址和位翻转寻址方式的设计。先讨论了循环寻址和位翻转寻址的设计思想和硬件实现算法,再根据算法设计了相应的电路,并且用Cadence工具Verilog-X... 文章介绍了DSP(digitalsignalprocessing)处理器中面向滤波、FFT、卷积、相关等算法的循环寻址和位翻转寻址方式的设计。先讨论了循环寻址和位翻转寻址的设计思想和硬件实现算法,再根据算法设计了相应的电路,并且用Cadence工具Verilog-XL进行了逻辑仿真。 展开更多

关键词 循环寻址 位翻转寻址 设计 循环缓冲器 微处理器 数字信号处理器 寄存器 DSP

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DMA控制器的设计与仿真 被引量：3

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作者 唐威 刘佑宝 +2 位作者 刘军华 段来仓 车德亮 《微电子学与计算机》 CSCD 北大核心 2002年第12期48-51,共4页

文章介绍了DSPSM9966中的双通道DMA控制器的主要功能和电路结构,给出了主要电路的实现方法,并引入存储器模型,举例说明了对其进行逻辑仿真的基本方法。

关键词 DMA控制器 设计 仿真 存储器 电路结构

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一种嵌入式SIMD协处理器地址产生器的设计(英文) 被引量：1

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作者 周国昌 沈绪榜 +1 位作者 王忠 车德亮 《微电子学与计算机》 CSCD 北大核心 2006年第11期4-7,共4页

文章介绍了一种新的嵌入式SIMD协处理器地址产生器。该地址产生器主要完成地址计算和协处理器指令的场抽取功能。为了提高协处理器的性能,地址产生器中设计了新的传送路径。该传送路径能够不通过地址产生器中的ALU而把数据送入寄存器中... 文章介绍了一种新的嵌入式SIMD协处理器地址产生器。该地址产生器主要完成地址计算和协处理器指令的场抽取功能。为了提高协处理器的性能,地址产生器中设计了新的传送路径。该传送路径能够不通过地址产生器中的ALU而把数据送入寄存器中,这个传送路径能够减少ldN指令的一个延迟周期。在SMIC0.18微米标准库单元下,该地址产生器的延迟能够满足周期为10ns的协处理器。 展开更多

关键词 SIMD协处理器 地址产生器 计算机体系结构 VLSI

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LS-DSP路由器的低功耗设计

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作者 李剑川 王忠 车德亮 《国防科技大学学报》 EI CAS CSCD 北大核心 2007年第4期52-56,共5页

LS-DSP是用于航天图像处理的数字信号处理器,内部的协处理器由处理元PE阵列构成。路由器则是实现PE阵列网格互连的专用部件,也是操作最频繁的部件。如何降低处理器功耗,提高算法的执行效率是一个非常重要的研究课题。针对LS-DSP路由器... LS-DSP是用于航天图像处理的数字信号处理器,内部的协处理器由处理元PE阵列构成。路由器则是实现PE阵列网格互连的专用部件,也是操作最频繁的部件。如何降低处理器功耗,提高算法的执行效率是一个非常重要的研究课题。针对LS-DSP路由器的电路进行门控时钟的低功耗设计改进,并以算法为例进行了控制、执行过程功耗分析和比较。实验结果表明,改进结构的路由器降低功耗76%。 展开更多

关键词 DSP 路由器 低功耗 门控时钟

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低功耗无磁流量测量MCU的系统设计 被引量：2

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作者 朱起淅 车德亮 沈绪榜 《西安电子科技大学学报》 EI CAS CSCD 北大核心 2010年第5期921-926,共6页

为了实现用于电表、水表、气表的微处理器芯片的低功耗运转,设计了一种用于无磁流量测量的16位低功耗微处理器.通过把流量测量模块设计成独立工作的模块,实现了测量过程中CPU一直处于休眠状态的工作方式;增加了一个可编程的频率连续可... 为了实现用于电表、水表、气表的微处理器芯片的低功耗运转,设计了一种用于无磁流量测量的16位低功耗微处理器.通过把流量测量模块设计成独立工作的模块,实现了测量过程中CPU一直处于休眠状态的工作方式;增加了一个可编程的频率连续可调专用动态时钟源来降低在各种应用测量过程中的动态功耗;通过门控时钟来关停CPU及锁相环等空闲模块,最终实现了26.8μA的系统低功耗运转。 展开更多

关键词 低功耗 微处理器 系统设计 无磁传感

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MPEG-2编码芯片中运动估计电路的设计 被引量：2

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作者 肖潇 葛维维 +1 位作者 车德亮 沈绪榜 《微电子学与计算机》 CSCD 北大核心 2006年第2期100-103,共4页

运动估计是视频压缩中最重要的环节,文章讨论了运动估计的基本原理并分析了其特点,采用了三步分层搜索算法,设计了一种基于MPEG-2的主档次标准的9PE全并行结构的高速运动估计电路,并通过FPGA验证,系统时钟频率达到35MHz,性能达到了实时... 运动估计是视频压缩中最重要的环节,文章讨论了运动估计的基本原理并分析了其特点,采用了三步分层搜索算法,设计了一种基于MPEG-2的主档次标准的9PE全并行结构的高速运动估计电路,并通过FPGA验证,系统时钟频率达到35MHz,性能达到了实时编码的要求。 展开更多

关键词 运动估计 MPEG-2编码 视频压缩 并行

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