BESⅢ触发快控制系统的设计与实现 被引量：2

1

作者 赵棣新 卢云鹏 +10 位作者 王科 张月圆 金大鹏 刘振安 过雅南 龚文煊 李陆 乔巧 王强 魏书军 徐昊 《核电子学与探测技术》 CAS CSCD 北大核心 2007年第2期174-179,共6页

介绍北京谱仪上的快控制系统的研究与设计。快控制系统主要由6种VME模块组成,它完成系统时钟和快控制命令的扇出和读出状态信号的处理与报警功能。根据不同的要求信号分别使用光纤串行和LVDS标准的差分并行两种数据传送方式。主要逻辑... 介绍北京谱仪上的快控制系统的研究与设计。快控制系统主要由6种VME模块组成,它完成系统时钟和快控制命令的扇出和读出状态信号的处理与报警功能。根据不同的要求信号分别使用光纤串行和LVDS标准的差分并行两种数据传送方式。主要逻辑用现场可编程的逻辑器件(FPGA)实现,系统按照高速电路的设计要求设计。 展开更多

关键词 快控制 触发 光纤串行传输

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计算机逻辑编程技术在谱仪触发判选系统中的应用 被引量：1

2

作者 赵棣新 丁慧良 +5 位作者 顾建辉 过雅南 李卫东 王菊芳 张月元 马恩成 《核电子学与探测技术》 CAS CSCD 北大核心 1996年第6期443-446,共4页

ＰＬＤ和ＦＰＧＡ是逐渐发展起来的可编程逻辑器件。可由用户用计算机编程实现需要的逻辑。本文简单介绍了器件的开发和在谱仪的触发判选系统中的应用。

关键词 触发判选 可编程逻辑器件 谱仪

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BES Ⅱ顶点探测器径迹组合触发判选系统

3

作者 赵棣新 丁慧良 +7 位作者 李卫东 马恩成 张月元 顾建辉 过雅南 郁忠强 谈益平 刘军 《核电子学与探测技术》 CAS CSCD 北大核心 1999年第3期206-210,共5页

在ＢＥＳⅡ中顶点探测器代替了ＢＥＳ的中心漂移室，建立了相应的触发判选子系统。介绍了ＢＥＳⅡ顶点探测器触发判选子系统的原理、构成、逻辑设计和结果。该系统是北京谱仪触发判选系统升级改进的主要项目之一。

关键词 北京谱仪 顶点探测器 触发判选 径迹组合

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FPGA多通道数据自动对齐的设计与实现 被引量：5

4

作者 魏书军 刘振安 +2 位作者 赵棣新 徐昊 卢云鹏 《核电子学与探测技术》 CAS CSCD 北大核心 2010年第3期410-412,327,共4页

介绍了一种多通道数据自动对齐的方法。该方法以FPGA技术为核心,通过状态机控制,并自动添加延迟寄存器的方式实现多通道数据对齐。它具有快速、灵活、通用等特点。

关键词 FPGA 多通道 自动对齐

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随机脉冲发生器 被引量：6

5

作者 过雅南 金大鹏 +2 位作者 乔巧 赵棣新 刘振安 《核电子学与探测技术》 CAS CSCD 北大核心 2007年第2期167-169,共3页

由于核衰变和粒子反应的随机性,探测器给出的信号在时间上是随机的,但一般的信号发生器给出的都是周期性的信号。为了测试电子学设备在输入随机信号时的性能,时间上随机的信号发生器是必要的。介绍了各种随机信号发生器,包括模拟式和数... 由于核衰变和粒子反应的随机性,探测器给出的信号在时间上是随机的,但一般的信号发生器给出的都是周期性的信号。为了测试电子学设备在输入随机信号时的性能,时间上随机的信号发生器是必要的。介绍了各种随机信号发生器,包括模拟式和数字式。一种数字式随机脉冲产生器是用单片机算出随机数,再用计数法给出随机脉冲;另一种用随机码发生电路给出时间上随机的信号,更为简便,可以嵌入FPGA中。 展开更多

关键词 随机 脉冲发生器

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基于FPGA中FIFO误码率软硬件测试方法 被引量：4

6

作者 王科 刘振安 +3 位作者 赵棣新 过雅南 徐昊 阴泽杰 《电子测量技术》 2004年第2期5-6,共2页

文中介绍用 FPGA中 FIFO的误码率软件和硬件测试方法,简介数据比较程序;说明硬件测试中伪随机码序列特点和生成原理,并对比较时如何使数据对应做出讨论。最后列出测试结果,比较这两种方法的优缺点。

关键词 FPGA FIFO 误码率 先进先出寄存器 伪随机码 线性反馈移位寄存器 测试 数字通信

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北京谱仪Ⅲ中触发数据并串结合传送方法的研究 被引量：2

7

作者 王科 刘振安 +2 位作者 赵棣新 过雅南 阴泽杰 《强激光与粒子束》 EI CAS CSCD 北大核心 2005年第1期145-148,共4页

北京谱仪中各探测器电子学系统向触发系统传输大量并行信号,需要采用并串结合型光纤传 输方法,以达到断开地回路,提高系统及线路抗干扰能力,延长传输距离的目的。对此种传输方法的误码率、报 错与恢复、延时一致性和相位稳定性... 北京谱仪中各探测器电子学系统向触发系统传输大量并行信号,需要采用并串结合型光纤传 输方法,以达到断开地回路,提高系统及线路抗干扰能力,延长传输距离的目的。对此种传输方法的误码率、报 错与恢复、延时一致性和相位稳定性等关键问题进行了深入研究,得到确切参数,并提出了单路出错自恢复同 步的解决方法,增强了系统的耐用性。同时发现各线路间传输延迟有半个周期的不一致,因此在接收端应把采 样时钟上升沿调整在所有解出数据都稳定的时刻。此方法可满足北京谱仪工程的实际需要。 展开更多

关键词 串行传输 并串转换 光纤 同步自恢复 传输延时

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VME总线在线“从串模式”配置FPGA的设计与实现 被引量：3

8

作者 魏书军 刘振安 +1 位作者 赵棣新 过雅南 《核电子学与探测技术》 CAS CSCD 北大核心 2007年第5期852-856,共5页

本文介绍了在线配置FPGA硬件设计及工作原理。所设计的系统可以使FPGA的配置数据通过VME总线写入到一片Flash Memory中,并在加电时或使用命令的方式通过Flash Memory来配置FPGA。另外,FPGA的配置数据还可以直接保存在PC机终端上,而不是F... 本文介绍了在线配置FPGA硬件设计及工作原理。所设计的系统可以使FPGA的配置数据通过VME总线写入到一片Flash Memory中,并在加电时或使用命令的方式通过Flash Memory来配置FPGA。另外,FPGA的配置数据还可以直接保存在PC机终端上,而不是Flash Memory中,在需要时,通过VME总线直接将配置数据配置给FPGA。 展开更多

关键词 从串模式 FPGA FLASH MEMORY CPLD

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BES-Ⅱ快速数据重建(英文) 被引量：2

9

作者 荣刚 张家文 +2 位作者 郭义庆 张少强 赵棣新 《核电子学与探测技术》 CAS CSCD 北大核心 2002年第2期105-110,共6页

报道了 BES- 快速数据重建的方法和结果 ,基于一个小型 PC FARM或一个分布式的网络Linux PC系统 ,发展建立了 BES- 快速数据重建系统。利用这一系统 ,BES- 实验组可以在数据采集后 2 0 min内完成完整的数据重建。用一台奔腾 (P - 80... 报道了 BES- 快速数据重建的方法和结果 ,基于一个小型 PC FARM或一个分布式的网络Linux PC系统 ,发展建立了 BES- 快速数据重建系统。利用这一系统 ,BES- 实验组可以在数据采集后 2 0 min内完成完整的数据重建。用一台奔腾 (P - 80 0 ) PC微机 ,12 min可以完成 30 0 0 0个由 BEPC(北京正负电子对撞机 )在质心系能量为 3.0 97Ge V处 e+e-对撞产生并由北京谱仪记录的数据的完整重建。利用这些重建的数据 ,在 BES- 实验中可以跟踪检查数据获取的质量 ,及时地解决硬件系统可能出现的问题 ,优化各子探测器硬件参数的设置。 展开更多

关键词 北京谱仪 BES-Ⅱ 北京正负电子对僮机 快速数据重建 PC FARM LINUX 数据采集

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BESIII触发系统MDC子系统光纤发送插件设计 被引量：2

10

作者 卢云鹏 刘振安 +4 位作者 徐昊 乔巧 李陆 赵棣新 赵京伟 《核电子学与探测技术》 CAS CSCD 北大核心 2008年第1期13-16,共4页

介绍了BESIII触发系统MDC子系统光纤发送插件的设计与测试。32通道的数据同步与展宽的实现由一片FPGA完成,基于RocketIO实现了1.75Gb/s波特率的串行数据光纤发送。文章给出了展宽电路和串行传输的测试结果。插件的设计达到了预期的设计... 介绍了BESIII触发系统MDC子系统光纤发送插件的设计与测试。32通道的数据同步与展宽的实现由一片FPGA完成,基于RocketIO实现了1.75Gb/s波特率的串行数据光纤发送。文章给出了展宽电路和串行传输的测试结果。插件的设计达到了预期的设计目标。 展开更多

关键词 展宽 ROCKETIO 串行传输 光纤

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高性能计算节点智能平台管理模块的设计 被引量：2

11

作者 王强 刘振安 +7 位作者 徐昊 金大鹏 李陆 卢云鹏 赵棣新 Tiago Perez Johannes Lang Wolfgang Kuehn 《核电子学与探测技术》 CAS CSCD 北大核心 2011年第5期495-498,517,共5页

即将应用到PANDA数据获取系统与触发系统及未来BESШ触发系统升级的高性能计算节点[5](HPCN)符合ATCA设计规范,基于IPMI协议的智能平台管理系统为其高可靠性提供保障。自主设计的智能平台管理模块具有丰富的板级管理功能,如Hot Swap和... 即将应用到PANDA数据获取系统与触发系统及未来BESШ触发系统升级的高性能计算节点[5](HPCN)符合ATCA设计规范,基于IPMI协议的智能平台管理系统为其高可靠性提供保障。自主设计的智能平台管理模块具有丰富的板级管理功能,如Hot Swap和电源分配协调,板上器件状态监控,与机箱控制器的协调通信等。主要介绍了智能平台管理系统在新一代总线中的应用、高性能计算节点的板上管理需求、智能平台管理模块的设计等内容。 展开更多

关键词 ATCA 高性能计算节点 智能平台管理

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GAL器件在触发判选径迹系统中的应用 被引量：1

12

作者 丁慧良 过雅南 +2 位作者 李启明 赵棣新 顾建辉 《核电子学与探测技术》 CAS CSCD 北大核心 1993年第5期293-298,共6页

本文简要介绍在北京谱仪触发判选的径迹系统中采用GAL器件作相“或”电路、符合配对电路及径迹数相加电路。

关键词 通用逻辑阵列 北京谱仪 中心漂移室 主漂移室 飞行时间计数器 反符合

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基于VME总线的流水线数字信号产生器的设计 被引量：1

13

作者 魏书军 刘振安 +1 位作者 赵棣新 过雅南 《核电子学与探测技术》 CAS CSCD 北大核心 2006年第3期349-351,共3页

介绍了基于VME流水线数字信号产生器工作原理、设计与实现过程。并就如何利用CPLD器件实现其复杂的控制作了较为详细的阐述。为实现流水线数字信号产生器提供了一种实现方案。

关键词 VME总线 流水线 CPLD LVDS

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FPGA，VHDL和BES主触发控制电路 被引量：1

14

作者 过雅南 王菊芳 赵棣新 《核电子学与探测技术》 CAS CSCD 北大核心 1996年第4期252-254,共3页

用高速的ＦＰＧＡ代替ＥＣＬ集成电路制作了北京谱仪的主触发电路，其设计过程中使用了硬件描述语言ＶＨＤＬ，得到了和原电路同样的性能，但增加了灵活性。

关键词 触发判选 集成电路 硬件描述语言 FPGA

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BESIII触发系统径迹计数插件的设计与实现

15

作者 李陆 徐昊 +3 位作者 刘振安 赵棣新 魏书军 赵京伟 《核电子学与探测技术》 CAS CSCD 北大核心 2008年第1期17-22,共6页

本文介绍BESIII触发系统径迹计数插件的设计与实现。该插件实现128通道的径迹计数功能,并输出触发条件;插件支持VME总线的读写操作和CBLT在线数据读出;所有功能在FPGA中实现,并以流水线工作方式工作。具备通过VME总线在线加载FPGA的功... 本文介绍BESIII触发系统径迹计数插件的设计与实现。该插件实现128通道的径迹计数功能,并输出触发条件;插件支持VME总线的读写操作和CBLT在线数据读出;所有功能在FPGA中实现,并以流水线工作方式工作。具备通过VME总线在线加载FPGA的功能。经过测试,插件达到了预期的设计目标,并已应用到BESIII工程MDC宇宙线实验中。 展开更多

关键词 触发 BESⅢ流水线 CBLT FPGA 在线加载

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BESⅡ 主漂移室径迹判选系统

16

作者 丁慧良 顾建辉 +8 位作者 郁忠强 过雅南 赵棣新 李卫东 马恩成 张月元 谈益平 杜玉远 姚卫良 《核电子学与探测技术》 CAS CSCD 北大核心 1999年第1期34-37,共4页

本文介绍升级改进后的北京谱仪（ＢＥＳⅡ）主漂移室径迹判选系统，叙述了该系统的性能和实现。电路中采用了可编程器件ＦＰＧＡ和ＧＡＬ，使判选系统更具灵活性和可靠性。

关键词 北京谱仪 主漂移室 径迹判选系统 谱仪

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北京谱仪 Ⅱ(BESⅡ)顶点探测器数据获取系统

17

作者 李小南 张炳云 +7 位作者 过雅南 张家文 杨长友 朱科军 沈红 赵棣新 Ken Young Watt Twomay 《核电子学与探测技术》 CAS CSCD 北大核心 1998年第5期348-351,共4页

北京谱仪（ＢＥＳⅡ）顶点探测器数据获取系统是北京谱仪数据获取系统的一部分，该子系统电子学采用快总线标准。本文描述了该系统的硬件结构和软件系统，软件包括快总线系统的微码软件和上层控制软件。该系统的死时间为１．５ｎｓ。对... 北京谱仪（ＢＥＳⅡ）顶点探测器数据获取系统是北京谱仪数据获取系统的一部分，该子系统电子学采用快总线标准。本文描述了该系统的硬件结构和软件系统，软件包括快总线系统的微码软件和上层控制软件。该系统的死时间为１．５ｎｓ。对ＢＥＳⅡ系统总死时间的贡献小于０．５ｍｓ。 展开更多

关键词 谱仪 顶点探测器 数据获取系统 快总线

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BESIII晶体量能器触发系统时间提取和块能量相加

18

作者 乔巧 赵棣新 +1 位作者 刘振安 过雅南 《核电子学与探测技术》 CAS CSCD 北大核心 2006年第6期868-873,共6页

介绍了北京谱仪III(BESIII)电磁量能器触发系统的触发单元和块能量相加(TCBA)板的设计、硬件实现和测试结果。该板主要完成对触发单元信号的甄别以便进行簇团的计数,并且提取电磁量能器的时间信息,同时将触发单元能量进一步相加形成块... 介绍了北京谱仪III(BESIII)电磁量能器触发系统的触发单元和块能量相加(TCBA)板的设计、硬件实现和测试结果。该板主要完成对触发单元信号的甄别以便进行簇团的计数,并且提取电磁量能器的时间信息,同时将触发单元能量进一步相加形成块能量信息。着重介绍了块能量相加、时间信息提取部分的设计和时间信息晃动的测试结果。 展开更多

关键词 电磁量能器 触发 甄别 时间的晃动

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数字式随机脉冲产生器 被引量：7

19

作者 富洪玉 过雅南 +1 位作者 赵棣新 宋宇 《核电子学与探测技术》 CAS CSCD 北大核心 2002年第2期162-165,共4页

介绍了一种时间间隔服从指数分布的随机脉冲的产生方法 ,并加以实现 ;用查表法产生服从指数分布的随机数 ,用 80 31单片机制作了一台可编程脉冲产生器 ,可用于产生周期或随机性脉冲 ,周期脉冲范围 10 0～ 9.999× 10 6 Hz,随机脉冲... 介绍了一种时间间隔服从指数分布的随机脉冲的产生方法 ,并加以实现 ;用查表法产生服从指数分布的随机数 ,用 80 31单片机制作了一台可编程脉冲产生器 ,可用于产生周期或随机性脉冲 ,周期脉冲范围 10 0～ 9.999× 10 6 Hz,随机脉冲范围为 2～ 10 4Hz。 展开更多

关键词 数字式随机脉冲产生器 单片机 随机信号 指数分布 查表法 泊松分布

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高精度事例时刻标定插件的设计 被引量：1

20

作者 周中良 刘振安 +3 位作者 李陆 金大鹏 赵棣新 王强 《核电子学与探测技术》 CAS CSCD 北大核心 2010年第5期592-596,605,共6页

介绍了BESⅢ触发系统高精度事例时刻标定插件的设计与实现,该插件可对触发系统产生的好事例判选信号L1*打上精确的时间标签。插件采用GPS授时方案;支持VME总线读写操作及CBLT在线数据读出;所有逻辑功能在FPGA中实现。最后给出了时间标... 介绍了BESⅢ触发系统高精度事例时刻标定插件的设计与实现,该插件可对触发系统产生的好事例判选信号L1*打上精确的时间标签。插件采用GPS授时方案;支持VME总线读写操作及CBLT在线数据读出;所有逻辑功能在FPGA中实现。最后给出了时间标签信息的输出结果,插件的设计达到了预期的设计目标。 展开更多

关键词 触发GPS授时 时间标签 FPGA CBLT

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