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基于PHEMT工艺的5GHz锁相环芯片 被引量:1
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作者 程树东 郁炜嘉 +3 位作者 朱恩 王雪艳 沈祯 王志功 《东南大学学报(自然科学版)》 EI CAS CSCD 北大核心 2004年第2期157-160,共4页
给出了基于 0 2 μm砷化镓赝晶高电子迁移率器件工艺设计的高速锁相环芯片的电路结构、性能分析与测试结果 .芯片采用吉尔伯特结构的鉴相器和交叉耦合负阻差分环形压控振荡器 ,总面积为 1 1 5mm× 0 75mm .锁定时中心工作频率为 ... 给出了基于 0 2 μm砷化镓赝晶高电子迁移率器件工艺设计的高速锁相环芯片的电路结构、性能分析与测试结果 .芯片采用吉尔伯特结构的鉴相器和交叉耦合负阻差分环形压控振荡器 ,总面积为 1 1 5mm× 0 75mm .锁定时中心工作频率为 4 44GHz ,锁定范围约为 360MHz,在1 0 0kHz频偏处的单边带相位噪声约 - 1 0 7dBc/Hz,经适当修改后可应用于光纤通信系统中的时钟数据恢复电路 . 展开更多
关键词 锁相环 鉴相器 压控振荡器 砷化镓赝晶高电子迁移率器件工艺
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鱼类必需脂肪酸概述 被引量:16
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作者 程树东 李英文 《内陆水产》 2004年第10期39-41,共3页
必需脂肪酸是鱼类必需的营养元素之一,它对鱼类的正常生长和发育有着十分重要的作用。本文参考了有关鱼类脂肪酸研究的资料对鱼类必需脂肪酸(EFA)的种类、需求量、营养生理功能、EFA缺乏症以及其来源和供给进行了综述。
关键词 鱼类 必需脂肪酸 EFA 营养生理功能 缺乏症 营养元素 种类 生长和发育 正常 综述
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具有90°可调移相的万兆以太网数据判决芯片设计 被引量:1
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作者 程树东 朱恩 +4 位作者 孟凡生 孙玲 吴春红 费瑞霞 王志功 《南京师范大学学报(工程技术版)》 CAS 2003年第4期71-74,共4页
介绍了用法国OMMIC公司 0 2 μmGaAsPHEMT工艺设计的具有 90°可调移相的万兆以太网数据判决芯片的模块及单元电路的结构 ,给出了仿真结果及版图 ,最后给出分析和结论 .该芯片的判决电路采用SCFL (源级耦合晶体管逻辑 )的D触发器结... 介绍了用法国OMMIC公司 0 2 μmGaAsPHEMT工艺设计的具有 90°可调移相的万兆以太网数据判决芯片的模块及单元电路的结构 ,给出了仿真结果及版图 ,最后给出分析和结论 .该芯片的判决电路采用SCFL (源级耦合晶体管逻辑 )的D触发器结构 ,根据矢量叠加原理设计 ,采用差动电流放大器构成可调移相器 .该芯片可直接用于万兆以太网IEEE 80 2 3ae中 10GBASE R和 10GBASE W的物理媒介配属层的时钟数据恢复模块中 . 展开更多
关键词 万兆以太网 数据判决 源级耦合晶体管逻辑 触发器 移相器 物理媒介配属层
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基于0.18μm CMOS工艺的千兆以太网数据判决电路芯片
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作者 程树东 朱恩 +4 位作者 郁炜嘉 沈祯 孟凡生 孙玲 王志功 《电子器件》 CAS 2003年第4期424-427,共4页
介绍了用TSMC0 18umCMOS工艺设计的千兆以太网数据判决芯片的模块及单元电路的结构,给出版图,后仿真及测试结果。该芯片采用CMOS互补逻辑的D触发器结构,功耗小于25mW,最高工作速率大于3 125Gbps,可直接用于千兆以太网物理媒介配属层的... 介绍了用TSMC0 18umCMOS工艺设计的千兆以太网数据判决芯片的模块及单元电路的结构,给出版图,后仿真及测试结果。该芯片采用CMOS互补逻辑的D触发器结构,功耗小于25mW,最高工作速率大于3 125Gbps,可直接用于千兆以太网物理媒介配属层的时钟数据恢复电路中。 展开更多
关键词 千兆以太网 数据判决 CMOS互补逻辑 触发器 物理媒介配属层
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基于0.18μm CMOS工艺的6 GHz环形压控振荡器设计 被引量:1
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作者 吴春红 朱恩 +3 位作者 王雪艳 郁炜嘉 程树东 王志功 《电子器件》 CAS 2003年第4期438-440,437,共4页
基于0 18μmCMOS工艺设计的全差分环形压控振荡器电路,芯片总面积为0 65×0 79mm2,1 8V电源供电,总功耗155mW,中心频率6GHz,调谐范围1GHz。可应用于IEEE802 11aWLAN系统。
关键词 射频集成电路 压控振荡器 CMOS工艺
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适用于万兆以太网10GBASE-X的全集成单片CMOS压控振荡器
6
作者 孟凡生 朱恩 +2 位作者 孙玲 程树东 王志功 《电子器件》 CAS 2004年第2期224-227,共4页
给出了一个适用于万兆以太网IEEE80 2 3ae 10GBASE -X的高线性度全集成单片环形压控振荡器电路。该压控振荡器采用TSMC 0 18μmCMOS混合信号工艺设计制造 ,由四级差分延时单元和输出驱动电路组成 ,芯片总面积为 0 3× 0 4mm2 ... 给出了一个适用于万兆以太网IEEE80 2 3ae 10GBASE -X的高线性度全集成单片环形压控振荡器电路。该压控振荡器采用TSMC 0 18μmCMOS混合信号工艺设计制造 ,由四级差分延时单元和输出驱动电路组成 ,芯片总面积为 0 3× 0 4mm2 。芯片采用 1 8V单电源供电 ,测得带直接耦合差分 5 0Ω负载时的总功耗为 78mW ,单端输出功率为 10 2dBm ,振荡频率在 2 8~ 4 0GHz有非常好的压控线性度 ,在振荡器中心频率为 3 12 5GHz时的单边带相位噪声为 - 96dBc/Hz@10MHz。 展开更多
关键词 压控振荡器 万兆以太网 模拟电路 互补金属氧化物半导体工艺
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0.18-μm CMOS千兆以太网并串转换芯片设计 被引量:1
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作者 郁炜嘉 朱恩 +7 位作者 程树东 孙玲 费瑞霞 沈桢 孟凡生 吴春红 王雪艳 王志功 《东南大学学报(自然科学版)》 EI CAS CSCD 北大核心 2004年第3期293-296,共4页
提出了一种新的树型结构 1 0∶1并串转换电路 ,可应用于千兆以太网 ,其工作速度达到 1 2 5Gbit/s.树型结构的使用可以使大部分电路工作在较低的速率上 ,从而简化了设计 ,也减小了功耗 .低速 5∶1并串转换单元采用改进的并行结构 ,利用... 提出了一种新的树型结构 1 0∶1并串转换电路 ,可应用于千兆以太网 ,其工作速度达到 1 2 5Gbit/s.树型结构的使用可以使大部分电路工作在较低的速率上 ,从而简化了设计 ,也减小了功耗 .低速 5∶1并串转换单元采用改进的并行结构 ,利用一系列D触发器调整进入数据选择器的时钟和数据间的相位关系 ,使其相对于普通并行结构有更大的相位裕量 ,可以更可靠地工作 .芯片应用TSMC 0 1 8 μmCMOS工艺实现 ,芯片面积为 0 7mm× 0 5mm ,核心电路功耗为 3 6mW ,小于同类电路 . 展开更多
关键词 千兆以太网 并串转换 CMOS
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