上海市教委副主任张民选谈弘扬珠算文化 发掘实用价值

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作者 张民选 《珠算与珠心算》 2006年第3期7-7,共1页

关键词 珠算文化 上海市 实用价值 副主任 教育委员会 发掘 科学研究院 张民选

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构建全球教师发展与职业变革的社会契约--基于对联合国教科文组织《全球教师报告》的解读 被引量：2

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作者 宋佳 卞翠 +1 位作者 李廷洲 张民选 《开放教育研究》 CSSCI 北大核心 2024年第3期53-62,共10页

全球中小学教师不仅在生师比上面临绝对性数量短缺,而且在学科、性别、高质量教师、地区分配等方面也存在结构性短缺。全球教师短缺归因于教师社会地位不高,学生从教意愿低,教师招聘与管理体制不畅,教师流失率高。基于此,不少国家的政... 全球中小学教师不仅在生师比上面临绝对性数量短缺,而且在学科、性别、高质量教师、地区分配等方面也存在结构性短缺。全球教师短缺归因于教师社会地位不高,学生从教意愿低,教师招聘与管理体制不畅,教师流失率高。基于此,不少国家的政府部门重视加强规划与调控,强化教师行业投资水平,提高教师社会地位与职业吸引力,以期建设更加稳定与高质量的教师队伍。 展开更多

关键词 教师短缺 联合国教科文组织 职业变革 社会契约

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国际视野下的学生全球胜任力:现状、影响及培养策略——基于PISA 2018全球胜任力测评结果的分析 被引量：18

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作者 张民选 朱福建 《开放教育研究》 CSSCI 北大核心 2020年第6期4-16,28,共14页

随着全球化和数字技术的发展,学生在互联互通世界中生活的能力越来越受到关注,"全球胜任力"逐渐成为评价学生发展的重要指标。PISA2018首次对15岁学生的全球胜任力进行了测评。结果显示,学生全球胜任力认知测试的总均分为474... 随着全球化和数字技术的发展,学生在互联互通世界中生活的能力越来越受到关注,"全球胜任力"逐渐成为评价学生发展的重要指标。PISA2018首次对15岁学生的全球胜任力进行了测评。结果显示,学生全球胜任力认知测试的总均分为474分,新加坡、加拿大、中国香港、英国苏格兰和中国台湾学生平均得分排在前五位。但全球胜任力是一种多维素养,涉及知识、技能、态度和价值观等,因此,评判一国(或地区)学生全球胜任力表现,不能仅看测试成绩,还应全面和谨慎地分析数据背后的信息。本研究采用内容分析和文本分析方法,结合相关测评数据,从测评背景、测评框架、测评结果、影响因素四方面,全面解读PISA2018全球胜任力测评结果报告,并在此基础上提出了四点建议,以期为我国学生全球胜任力的培养提供启示。 展开更多

关键词 PISA2018 全球胜任力 测评结果 报告解读

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纳米级集成电路的软错误问题及其对策 被引量：1

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作者 张民选 孙岩 宋超 《上海交通大学学报》 EI CAS CSCD 北大核心 2013年第1期1-6,12,共7页

介绍了纳米级集成电路中软错误的发生机制、发展趋势以及评估技术,概括了软件、电路和体系结构以及工艺器件级软错误的缓解对策,并针对软错误问题相关研究的发展提出几点建议.

关键词 软错误 集成电路 可靠性

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澳大利亚:迅速崛起的教育出口大国 被引量：14

5

作者 张民选 《职业技术教育》 北大核心 2003年第36期62-65,共4页

在世界高等教育领域,澳大利亚的机构数量相当有限(只有43所大学),也没有可以与哈佛、耶鲁、牛津、剑桥比肩的著名学府,甚至没有一所大学能够真正"进入世界100强"。然而,却在2002年华盛顿"国际教育服务贸易论坛"上... 在世界高等教育领域,澳大利亚的机构数量相当有限(只有43所大学),也没有可以与哈佛、耶鲁、牛津、剑桥比肩的著名学府,甚至没有一所大学能够真正"进入世界100强"。然而,却在2002年华盛顿"国际教育服务贸易论坛"上赢得了"教育出口大国"的赞誉。事实上,澳大利亚已经成为世界第五大外国留学生接受国,留学生占在校大学生比例的12.6%,排位世界第二。 展开更多

关键词 澳大利亚 教育出口 留学生 知识产业 高等教育

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软硬结合的迭代除法方案及其精度分析

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作者 张民选 李晓梅 《国防科技大学学报》 EI CAS CSCD 北大核心 1989年第1期28-34,共7页

大型机采用的软硬结合的迭代除法方案具有很高的计算速度,但存在精度合理性问题。经过大量随机数试算验证和算法的误差分析证明,本文中提供的优选除法方案,提高了除法精度,解决了精度合理性问题。该除法方案装机运行后,提高了大型机的... 大型机采用的软硬结合的迭代除法方案具有很高的计算速度,但存在精度合理性问题。经过大量随机数试算验证和算法的误差分析证明,本文中提供的优选除法方案,提高了除法精度,解决了精度合理性问题。该除法方案装机运行后,提高了大型机的适应能力和运算速度,改善了处理效果。 展开更多

关键词 软硬件结合 迭代除法 清度分析

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巨型机中软硬结合的函数计算方案

7

作者 张民选 《国防科技大学学报》 EI CAS CSCD 北大核心 1996年第3期115-120,共6页

本文分别讨论了巨型机中计算ｙ／ｘ、ｙ／、ａｘ、ｌｏｇａｘ、ｘｙ等函数的算法设计及其误差分析。

关键词 巨型机 函数 计算机 软件 硬件 算法

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向量巨型机高效程序设计技术

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作者 张民选 《国防科技大学学报》 EI CAS CSCD 北大核心 1995年第4期81-85,96,共6页

本文着重研究适应向量巨型机体系结构的高效程序设计技术。围绕减少指令流水线阻塞，提高多功能部件并行度，数据调度与局部化技术三个方面进行了深入的讨论，给出了一系列设计高效程序的方法和技巧。

关键词 流水线 并行度 数据调度 程序设计 巨型计算机

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基于多种资源的负载平衡算法的研究 被引量：27

9

作者 蒋江 张民选 廖湘科 《电子学报》 EI CAS CSCD 北大核心 2002年第8期1148-1152,共5页

系统资源的有效利用是集群系统的关键问题 ,负载平衡是实现资源有效利用的重要手段 .本文 ,提出了两种基于资源使用率和向量负载指数的、采用进程迁移机制的负载平衡算法 ,并通过踪迹驱动的方法进行了大量的模拟和分析 .

关键词 集群 异构性 网络互连 负载平衡 资源使用率 进程迁移 向量负载指数

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一种异构多核处理器的并行流存储结构 被引量：7

10

作者 邓让钰 陈海燕 +7 位作者 窦强 徐炜遐 谢伦国 戴泽福 李永进 夏军 罗莉 张民选 《电子学报》 EI CAS CSCD 北大核心 2009年第2期312-317,共6页

异构多核处理器可结合多种处理器体系结构的优势,既保留传统通用体系结构的灵活性,又拥有大量计算资源,可提供更高的峰值计算性能.YHFT64-3异构多核处理器中浮点处理部件18套,峰值计算能力强大,设计与之相匹配的存储系统是一项重大挑战... 异构多核处理器可结合多种处理器体系结构的优势,既保留传统通用体系结构的灵活性,又拥有大量计算资源,可提供更高的峰值计算性能.YHFT64-3异构多核处理器中浮点处理部件18套,峰值计算能力强大,设计与之相匹配的存储系统是一项重大挑战.针对YHFT64-3处理器,本文提出了一种并行流层次存储结构,深入阐述了如何体现应用特点、支持并行数据流处理的存储系统的设计思想和方法,从多个层次实现对并行数据流的挖掘或捕获.测试结果表明,这种存储结构体现了应用特点,能够较好地发挥YHFT64-3处理器的性能,同频情况下(500MHz),YHFT64-3比YHFT64-2性能高2—3个数量级,与1.6GHz的Itanium2性能相当,但代价更低. 展开更多

关键词 异构多核处理器 流体系结构 预取 存储调度 优化的锁步执行模型

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1.5-6GHz增益和噪声系数稳定的两级超宽带CMOS低噪声放大器设计与性能模拟 被引量：11

11

作者 何小威 李晋文 张民选 《电子学报》 EI CAS CSCD 北大核心 2010年第7期1668-1672,共5页

针对UWB应用设计实现了一个1.5-6GHz的两级CMOS低噪声放大器(LNA).通过引入共栅(CG)和共源(CS)结构以获得宽范围内的输入匹配,采用电流镜和峰化电感进行电流复用,所提出的LNA实现了非常平坦化的功率增益和噪声系数(NF).经标准0.18μm C... 针对UWB应用设计实现了一个1.5-6GHz的两级CMOS低噪声放大器(LNA).通过引入共栅(CG)和共源(CS)结构以获得宽范围内的输入匹配,采用电流镜和峰化电感进行电流复用,所提出的LNA实现了非常平坦化的功率增益和噪声系数(NF).经标准0.18μm CMOS工艺实现后,版图后模拟结果表明在1.5-5GHz频率范围内功率增益(S21)为11.45±0.05dB,在2-6GHz频率范围内噪声系数(NF)为5.15±0.05dB,输入损耗(S11)小于-18dB.在5GHz时,模拟得到的三阶交调点(IIP3)为-7dBm,1dB压缩点为-5dBm.在1.8V电源电压下,LNA消耗6mA的电流,版图实现面积仅为0.62mm2. 展开更多

关键词 超宽带 低噪声放大器 噪声系数 宽带 CMOS

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LRU-Assist:一种高效的Cache漏流功耗控制算法 被引量：6

12

作者 张承义 张民选 +1 位作者 邢座程 王永文 《电子学报》 EI CAS CSCD 北大核心 2006年第9期1626-1630,共5页

随着集成电路制造工艺进入超深亚微米阶段,漏电流功耗在微处理器总功耗中所占的比例越来越大,在开发新的低漏流工艺和电路技术之外,如何在体系结构级控制和优化漏流功耗成为业界研究的热点.Cache在微处理器中面积最大,是进行漏流控制的... 随着集成电路制造工艺进入超深亚微米阶段,漏电流功耗在微处理器总功耗中所占的比例越来越大,在开发新的低漏流工艺和电路技术之外,如何在体系结构级控制和优化漏流功耗成为业界研究的热点.Cache在微处理器中面积最大,是进行漏流控制的首要部件.LRU是组相联Cache最常用的替换算法,而研究发现,访存操作命中LRU后半区的概率很低.LRU-Assist算法以Drowsy Cache、Cache Decay等控制策略为基础,在保证处理器性能不受影响的前提下,利用既有的LRU信息把Cache的关闭率平均提高了15%,大大降低了漏电流功耗. 展开更多

关键词 微处理器 cache功耗 漏电流 LRU-assist

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差分压控振荡器中单粒子瞬变的研究 被引量：5

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作者 赵振宇 蒋仁杰 +2 位作者 张民选 胡军 李少青 《国防科技大学学报》 EI CAS CSCD 北大核心 2009年第2期81-85,共5页

压控振荡器(VCO)是锁相环(PLL)中对于单粒子瞬变(SET)最为敏感的部件之一。基于180nm体硅CMOS工艺设计了一款经典的对称负载结构差分VCO电路,并利用电流源表征单粒子效应中电荷沉积和收集的过程,模拟了VCO电路的SET响应。模拟和分析表明... 压控振荡器(VCO)是锁相环(PLL)中对于单粒子瞬变(SET)最为敏感的部件之一。基于180nm体硅CMOS工艺设计了一款经典的对称负载结构差分VCO电路,并利用电流源表征单粒子效应中电荷沉积和收集的过程,模拟了VCO电路的SET响应。模拟和分析表明,SET响应不仅取决于入射能量、振荡频率,还受到轰击时刻的制约,不同轰击时刻产生的最大相位差可以相差300°以上。此外,偏置电路某些结点最为敏感,可以放大SET的影响,导致时钟失效长达7个周期。 展开更多

关键词 单粒子效应 单粒子瞬变 压控振荡器

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一种新型的抗DPA攻击可配置逻辑结构 被引量：3

14

作者 乐大珩 张民选 +2 位作者 李少青 孙岩 谷晓忱 《电子学报》 EI CAS CSCD 北大核心 2011年第2期453-457,共5页

DPA(Differential Power Analysis)攻击的强度取决于芯片电路功耗与所处理的数据之间的相关性以及攻击者对算法电路实现细节的了解程度.本文结合动态差分逻辑和可配置逻辑的特点,提出了一种具有抗DPA攻击能力的双端输出可配置逻辑(DRCL:... DPA(Differential Power Analysis)攻击的强度取决于芯片电路功耗与所处理的数据之间的相关性以及攻击者对算法电路实现细节的了解程度.本文结合动态差分逻辑和可配置逻辑的特点,提出了一种具有抗DPA攻击能力的双端输出可配置逻辑(DRCL:Dual-Rail Configurable Logic).该逻辑一方面具有与数据取值无关的信号翻转率和信号翻转时刻,因而能够实现很好的功耗恒定特性;另一方面去除了电路结构与电路功能之间的相关性,从而可以阻止攻击者通过版图逆向分析的方法窃取算法电路实现细节.实验结果表明,DRCL比典型的抗DPA攻击逻辑WDDL(Wave Dynamic Differential Logic)具有更好的功耗恒定性,因而具有更强的DPA攻击防护性能. 展开更多

关键词 安全芯片 旁路攻击 功耗分析攻击 动态差分逻辑 可配置逻辑

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一款0.18μm CMOS辐射加固差分压控振荡器 被引量：3

15

作者 赵振宇 郭斌 +1 位作者 张民选 刘衡竹 《国防科技大学学报》 EI CAS CSCD 北大核心 2009年第6期12-17,共6页

基于对称负载压控振荡器(VCO)的单粒子瞬变(SET)失效机理,应用设计加固(RHBD)技术分别改进了偏置电路和环形振荡器,设计和实现了一款0.18μm CMOS辐射加固差分VCO。模拟结果表明:加固VCO的SET敏感性大幅降低,同时还降低了抖动对于电源... 基于对称负载压控振荡器(VCO)的单粒子瞬变(SET)失效机理,应用设计加固(RHBD)技术分别改进了偏置电路和环形振荡器,设计和实现了一款0.18μm CMOS辐射加固差分VCO。模拟结果表明:加固VCO的SET敏感性大幅降低,同时还降低了抖动对于电源噪声的敏感性。虽然电路结构变化会导致频率下降,但可以通过调整电路尺寸而解决。此外,加固VCO面积开销有所降低,优于其他加固方法。 展开更多

关键词 单粒子效应 单粒子瞬变 压控振荡器 RHBD

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片上网络中一种单周期2GHz无缓冲路由器 被引量：3

16

作者 冯超超 鲁中海 +1 位作者 张民选 李晋文 《国防科技大学学报》 EI CAS CSCD 北大核心 2011年第6期42-47,共6页

近年来,无缓冲路由器由于不需要缓冲器而成为片上网络低开销的解决方案。为了提高无缓冲路由器的性能,提出一种单周期高性能无缓冲片上网络路由器。该路由器使用一个简单的置换网络替换串行化的交换分配器与交叉开关以实现高性能。虚通... 近年来,无缓冲路由器由于不需要缓冲器而成为片上网络低开销的解决方案。为了提高无缓冲路由器的性能,提出一种单周期高性能无缓冲片上网络路由器。该路由器使用一个简单的置换网络替换串行化的交换分配器与交叉开关以实现高性能。虚通道路由器与基准无缓冲路由器相比,该路由器在TSMC65nm工艺下可以以较小的面积开销达到2GHz的时钟频率。在合成通信负载与真实应用负载下的模拟结果表明,该路由器的包平均延迟远小于虚通道路由器和其他无缓冲路由器。 展开更多

关键词 片上网络 无缓冲路由器 偏转路由 置换网络

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基于模拟退火算法的浮点转定点自动位宽优化工具 被引量：3

17

作者 黎渊 蒋江 +1 位作者 张民选 魏少军 《上海交通大学学报》 EI CAS CSCD 北大核心 2013年第1期76-80,85,共6页

开发了一套浮点转定点自动位宽优化软件系统(SATRANS),能够将用户输入的描述目标系统的浮点程序自动转换为位宽可配置的定点程序,并基于模拟退火算法进行自动位宽搜索,以得到满足精度要求的操作数定点位宽组合.同时,以IIR数字滤波器为例... 开发了一套浮点转定点自动位宽优化软件系统(SATRANS),能够将用户输入的描述目标系统的浮点程序自动转换为位宽可配置的定点程序,并基于模拟退火算法进行自动位宽搜索,以得到满足精度要求的操作数定点位宽组合.同时,以IIR数字滤波器为例对SATRANS进行了实现与验证.结果表明,SATRANS的搜索结果优于传统贪心算法的搜索结果,并能够获得一系列满足精度要求的解,从而使得芯片设计人员能够在精度与复杂度等要素之间加以权衡,并选择一组最合适的位宽组合而用于芯片设计中.选择搜索结果中的面积最优解来配置IIR系统并在XilinxVirtex-6FPGA芯片中实现,相对于IEEE浮点单/双精度系统,其性能分别提高了12.4%和62.8%,面积的降幅分别为93.9%和97.9%. 展开更多

关键词 位宽优化 模拟退火算法 浮点转定点 数字滤波器

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基于LBDL逻辑的抗DPA攻击电路设计方法 被引量：3

18

作者 乐大珩 李少青 张民选 《国防科技大学学报》 EI CAS CSCD 北大核心 2009年第6期18-24,共7页

动态差分逻辑是一种典型的电路级差分功耗攻击(DPA)防护技术。这种技术通过使逻辑门保持恒定的翻转率来降低电路功耗与数据信号之间的相关性。介绍了一种新型的、基于查找表(Look-Up-Table,LUT)结构的动态差分逻辑(LBDL),以及基于这种... 动态差分逻辑是一种典型的电路级差分功耗攻击(DPA)防护技术。这种技术通过使逻辑门保持恒定的翻转率来降低电路功耗与数据信号之间的相关性。介绍了一种新型的、基于查找表(Look-Up-Table,LUT)结构的动态差分逻辑(LBDL),以及基于这种逻辑的集成电路设计方法。该设计方法仅需在传统的半定制设计流程中添加少量的替换操作就可以实现,因而比其他完全需要全定制设计的动态差分逻辑具有更好的实用性。而相对同样适用于半定制实现的动态差分逻辑WDDL(Wave Dynamic Differential Logic),LBDL逻辑解决了逻辑门翻转时刻与数据信号之间的相关性,从而比WDDL逻辑具有更好的功耗恒定性。实验结果表明,该设计方法能够有效实现具有抗DPA攻击性能的电路。 展开更多

关键词 安全芯片 DPA攻击 动态差分逻辑

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指令cache体系结构级功耗控制策略研究 被引量：4

19

作者 周宏伟 张民选 《电子学报》 EI CAS CSCD 北大核心 2008年第11期2107-2112,共6页

随着工艺尺寸缩小及处理器频率提高,功耗问题已成为当代微处理器设计面临的主要挑战.传统的指令cache(I-Cache)功耗控制策略一般只单独降低指令cache的动态或者静态功耗.提出的两种改进的功耗控制策略,基于昏睡指令cache体系结构,能够... 随着工艺尺寸缩小及处理器频率提高,功耗问题已成为当代微处理器设计面临的主要挑战.传统的指令cache(I-Cache)功耗控制策略一般只单独降低指令cache的动态或者静态功耗.提出的两种改进的功耗控制策略,基于昏睡指令cache体系结构,能够更有效地同时降低指令cache的动态和静态功耗.一种称作"使用双预测端口路预测器的多路路预测策略",另一种称作"基于分阶段访问cache的按需唤醒预测策略",分别用于处理器前端流水线级数保持不变和可以增加额外前端流水线级数两种情形.实验结果表明:与传统的策略相比,提出的两种策略具有更优的能量效率,可以在不显著影响处理器性能的前提下,更有效地降低指令cache和处理器的功耗. 展开更多

关键词 指令 CACHE 功耗 体系结构

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基于多个取指优先级的同时多线程处理器取指策略 被引量：3

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作者 孙彩霞 张民选 《电子学报》 EI CAS CSCD 北大核心 2006年第5期790-795,共6页

同时多线程(SMT,SimultaneousMultithreading)处理器中,同时运行的线程在共享资源的同时也在竞争资源.如果一个发生L2 cache失效的线程长时间占用共享资源,那么会导致其他线程运行速度减慢,甚至会因为缺少资源而停顿下来,从而降低了SMT... 同时多线程(SMT,SimultaneousMultithreading)处理器中,同时运行的线程在共享资源的同时也在竞争资源.如果一个发生L2 cache失效的线程长时间占用共享资源,那么会导致其他线程运行速度减慢,甚至会因为缺少资源而停顿下来,从而降低了SMT处理器的总体性能.本文提出了一种基于多个取指优先级的同时多线程取指策略MFP(Multiple Fetch Priorities),用于减少L2 cache失效给处理器性能带来的负面影响.模拟结果表明,无论使用IPC作为度量标准还是使用Hmean作为度量标准,对于所有类型的工作负载,尤其是存储器访问密集的工作负载,MFP都要优于现有的其他取指策略.此外,对于不同的取指策略,MFP表现出不同程度的提升.相对于PDG的提升最明显,平均IPC以及平均Hmean分别提高了19.2%和27.7%. 展开更多

关键词 同时多线程 cache失效 取指策略 取指优先级 资源分配

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